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μ PD44647094A-A, 44647184A-A, 44647364A-A, 44647096A-A, 44647186A-A, 44647366A-A
Output Pin States of CQ, CQ#, QVLD and Q
Instructions
Control-Register Status
Output Pin Status
CQ, CQ#, QVLD
Q
EXTEST
IDCODE
SAMPLE-Z
SAMPLE
BYPASS
0
1
0
1
0
1
0
1
0
1
Update
Update
SRAM
SRAM
High-Z
High-Z
SRAM
SRAM
SRAM
SRAM
High-Z
Update
SRAM
SRAM
High-Z
High-Z
SRAM
SRAM
SRAM
SRAM
Remark
The output pin statuses during each instruction vary according
to the Control-Register status (value of Boundary Scan
Register, bit no. 109).
There are three statuses:
Boundary Scan
Register
CAPTURE
Register
Update : Contents of the “Update Register” are output to
the output pin (QDR Pad).
SRAM : Contents of the SRAM internal output “SRAM
Output” are output to the output pin (QDR Pad).
High-Z : The output pin (QDR Pad) becomes high
impedance by controlling of the “High-Z JTAG
ctrl”.
The Control-Register status is set during Update-DR at the
Update
Register
Update
QDR
Pad
High-Z
SRAM
Output
Driver
SRAM
Output
SRAM
EXTEST or SAMPLE instruction.
High-Z
JTAG ctrl
In case checking the QVLD output status in EXTEST mode,
please make sure stay DLL# pin HIGH.
Data Sheet M19962EJ2V0DS
29
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